Vyhledat

Introduction to Visualizer for the Verilog Users

Technická podpora

PCSCHEMATIC (+420) 728 304 701
PADS, CAM350, BluePrint (+420) 737 740 487

CADware s.r.o. » Aktuálně » Výstavy a semináře » Introduction to Visualizer for the Verilog Users

Vzhledem k současné situaci a nařízení vlády byly ODLOŽENY semináře programů ModelSim, PADS a PCSCHEMATIC.

16. 6. 2020 17:00 - 18:00 SELČ online webinář

Complex testing and methodology with complex silicon require powerful but simple to use debug solutions. The Visualizer Debug Environment provides a common debug solution for simulation, emulation and other engines, including Verilog, VHDL, UVM, SystemC, C/C++, Assertions and Coverage.

This session will introduce the Visualizer Debug Environment for Verilog and UVM.

What You Will Learn:

  • Post-simulation and live-simulation debug
  • Driver tracing and X-tracing
  • Source code debug
  • Waveform debug
  • UVM Debug, including classes and transactions in the waveform

Na tento online seminář se můžete registrovat také ze stránek výrobce programu, společnosti Mentor, A Siemens business.

Více o programu ModelSim